布线工程师如何充分“掌控”时钟信号？
图4 插入及轻易识别占位符或排除缓冲器
提供超出预期的时钟图表及大量时钟简介。当前工序设计准备好提供网表进行布线时，他们已经非常熟悉设计及时钟要求。某些情况下，初始CTS设计会提示预布线时序约束中使用的理想值在实际物理设计中不能实现的情况。如果提供了精确的时钟图以及带有时钟原理相关信息的网表交递，就能够更快地弄清导致此状况的问题。
总体图或是代表设计中所有时钟（含门控逻辑）的图非常有用。这要么是采用画图软件，要么是使用电路图捕获工具等使用软件产生的图，甚至还可以是手绘并存储为PDF文档或发送传真给布线工程师的图。此图抵得上尝试直接获得时钟格式的多次通话或电子邮件沟通过程中的千言万语。
由于图表可能会很复杂繁琐，就需要提供相应的简介文档，包括产生的时钟、任何时钟门控或复用图案的详情以及歪曲率平衡和延迟要求等方面的阐释。每种工作模式都需要这些详细信息，因为在插入时钟树期间必须应对每种模式。寄存器可能最后会提供用于功能模式的平衡，但如果我们不仔细的话，测试模式下可能极不平衡。
如果时钟使用DLL或其他宏或它通过门控逻辑，这些详细信息就在所必需了。如果有需要的话，有可能通过那些类型的宏来合成及平衡。对于门控逻辑而言，如果存在一个引脚通过一种模式来连接、但同单元的其他引脚采用另一种模式来连接的情况，走线工具将把这种情况识别为“重汇聚时钟”。虽然布线工具可以解决这些问题，但更好的解决办法可能是迫使工具在时间插入期间查看这个引脚而非其他引脚。
业界软件工具中的CTS
业界软件遵循设计人员的规格及指引，以强大的工具推动时钟树合成。源自前工序的跟时钟树根插入点、延迟、歪曲率及过渡目标相关的信息以及用于门控逻辑、通过寄存器和跨域关系的详细信息能够直接移植到CTS工具中。然后布线工程师将自已判断要使用的缓冲器类型、优化迭代及间距、屏幕和金属层等布线要求。大电流电感
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