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射频集成电路的电源管理

2016-12-29 06:15:40      点击次数:278
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射频集成电路的电源管理

  图9. 5 V电源设计
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  图10. 3.3 V电源设计

  3.3 V设计允许进行更多实验。除了用一个LDO或开关调节器驱动3.3 V供电轨以外,VPOS_PLL供电轨有额外LDO选项,VPOS_DIG供电轨有一个可选的隔离式LDO。由于PLL电源灵敏度最高,因此,我们尝试了三种电源解决方案,每一种都有不同的输出噪声:ADP151 3.3 V超低噪声CMOS LDO,输出噪声为9 µV;ADP7104 3.3 V低噪声CMOS LDO,输出噪声为15 µV rms;ADP2370 3.3 V降压调节器。我们希望确定仍能维持所需相位噪声性能的最高电源噪声。最高性能、最低噪声LDO是不可或缺的吗?

  另外还尝试在VPOS_DIG供电轨上采用ADP121 3.3 V低噪声CMOS LDO,以确定数字噪声是否会影响性能。受SPI接口开关影响,数字供电轨的噪声一般高于模拟电源。我们希望确定3.3 V数字电源是需要自己的LDO,还是可以直接耦合到模拟电源。我们选择ADP121作为低成本解决方案。

射频集成电路的电源管理

  图11. 使用ADP151和ADP7104时的集成相位噪声
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  图12. 使用ADP151和ADP2370时的集成相位噪声大电流电感

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