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射频集成电路的电源管理

2016-12-29 06:15:40      点击次数:
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射频集成电路的电源管理

  图5. IF ± CW去耦电容谐振的影响

  结果

  测量了基带输出端的供电轨上干扰信号(CW)和调制信号(IF ± CW)的幅度。在被测供电轨上引入了噪声,其他电源则保持洁净。图6所示为在电源引脚上注入0 dB正弦信号并在30 kHz至1 GHz范围内扫频时(IF ± CW)音的幅度。图7所示为从CW音到基带输出的馈通。

射频集成电路的电源管理

  图6. (IF ± CW)音的PSRR
射频集成电路的电源管理

  图7. CW音的PSRR

  分析

  图中提供了各电源引脚处的电源灵敏度数据,这些数据非常有用。VPOS_PLL具有最差电源抑制性能,因此,是最灵敏的电源节点。该电源引脚驱动PLL电路,包括参考输入频率、相位频率检测器和电荷泵。这些灵敏的功能模块决定着LO信号的精度和相位性能,因此,其上耦合的任何噪声都会直接传播到输出端。

  同理,可以认为VCO电源也是一个非常重要的节点。从图中可以看出,VPOS_VCO的抑制性能远远优于VPOS_PLL。这是实际驱动VCO的内置LDO造成的结果。LDO将VCO与外部引脚上的噪声隔离开,同时为其提供固定噪声频谱密度。PLL电源无LDO,因而是最敏感的供电轨。可见,将其与潜在噪声耦合相隔离对于获得最佳性能至关重要。大电流电感

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