基于FPGA的速率自适应图像抽取算法
回放的速率取决于下行信道的速率，工程中由上级的回放请求信号控制。在每次请求到来时，均加载预先存入的最新图像地址，既保证了图像实时性，又达到了抽取速率自适应的要求。
抽帧回放算法主要考虑三个方面：抽取图像为完整的载荷图像数据；当前抽取出的图像为最新数据；抽取算法对抽取速率自适应。
1.1 完整性设计
输入图像数据由接口模块生成VCDU，不同载荷数据通过VCID 被区分为不同类的VCDU，由于FLASH 采用页操作模式，一页的大小为2 KB，设计中一页包含两个VCDU.
FLASH的读写都基于页进行操作，读出一页的两个VCDU中，有多种可能性，数据处理过程如图2 所示，图2中给出三种可能，一是前一个是需要抽取的头数据，后一个是需要抽取的中间数据；二是前一个是需要抽取的图像数据，后一个是不需要抽取的其他 VCDU 数据；三是前一个是需要抽取的尾数据，后一个是下一幅图像的头，但不需要抽取。
可见，在抽取回放中必须滤除一定数据，保证抽取图像的完整性和正确性，因此在存储时增加附加信息，以解决图像完整性问题。
附加信息设计为6 b，格式定义见表1.
附加信息与数据一起被存到存储芯片中。在回放时，读取附加信息，解析出高VCDU有效/无效信号和低VCDU有效/无效信号。由回放请求模块进行数据滤除，保证仅回放有效数据，并且为完整图像。
附加信息与有效标志映射关系见表2.对输入数据的各种情况，按照表2中映射关系解析出有效/无效信号。大电流电感
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